Studienarbeit aus dem Jahr 2010 im Fachbereich Elektrotechnik, Note: 1,0, Technische Universit t Dresden, Sprache: Deutsch, Abstract: Ziel des Praktikums ist die Realisierung einer algorithmischen Aufgabenstellung als integrierter Schaltkreis (engl. Integrated Circuit - IC). Der Entwurf und die Verifikation des Schaltkreises bzw. Prozessors erfolgt im ASIC (engl. Application Specific Integrated Circuit) mit Standardzellen in 0.35 m CMOS-Technologie mit der EDA-Software CADENCE. Die Entscheidung f r die numerische mathematische Rechenvorschrift fiel zu gunsten der Polynomdivision aus. Der Algorithmus f hrt mit einer zum Teil vorgegebenen Speicherbelegung Operationen durch und speichert das Ergebnis wieder im Hauptspeicher ab. Dabei wird ein vertiefender Einblick in den Entwurf komplexer VLSI-Schaltungen vermittelt. Der Entwurfsfluss (Designflow) erfolgt nach der Top-down Strategie. Das Top-Down-Design beginnt mit der Formulierung eines berblicks ber das System, wobei Details zun chst vernachl ssigt werden. Anschlie end erfolgt die Unterteilung in Abschnitte, wobei die gew nschte Funktionalit t zun chst umgangssprachlich angegeben wird. Im Folgenden werden diese Abschnitte genauer ausformuliert, bis schlie lich die komplette, detaillierte Spezifikation des Algorithmus erreicht ist. Bei der Top-Down-Methode liegt der Schwerpunkt auf Planung und Verst ndnis des Systems.
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