Apresento um novo design para um somador de 1 bit com estilo de design h brido-CMOS. A minha abordagem permite obter opera es de baixo consumo em tecnologia de 90nm. O estilo de conce o h brido-CMOS utiliza v rios circuitos de estilo CMOS Iogic para construir novos somadores completos com as especifica es desejadas. O novo circuito SERF- full adder (FA) optimizado para um funcionamento de ultra baixo consumo baseia-se em portas XOR modificadas com clock gating para minimizar o consumo de energia. Al m disso, generaliza as sa das de balan o total em simult neo. O novo circuito de somador completo funciona com sucesso a baixas tens es com excelente integridade de sinal. O novo somador apresentou melhores m tricas de pot ncia e atraso em compara o com os somadores completos padr o. Para avaliar o desempenho do novo somador completo num circuito real, realiz mos compressores 4-2,5-2,5-3,7-2,11-2,15-4,31-5 que s o basicamente utilizados em m dulos multiplicadores de filtros DSP. S o apresentados resultados simulados utilizando a tecnologia CMOS de 90nm padr o. Os resultados da simula o mostram uma redu o de 5% - 20% na pot ncia e no atraso para a frequ ncia de 50MHz e tens es de alimenta o de 1,1 v.
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